adds the missing vector csrs to the architectural state
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77807fec01
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e59458aa0e
@ -176,18 +176,27 @@ if(fcsr != null) {%>
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def vstart = registers.find {it.name=='vstart'}
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def vstart = registers.find {it.name=='vstart'}
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def vl = registers.find {it.name=='vl'}
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def vl = registers.find {it.name=='vl'}
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def vtype = registers.find {it.name=='vtype'}
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def vtype = registers.find {it.name=='vtype'}
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def vxsat = registers.find {it.name=='vxsat'}
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def vxrm = registers.find {it.name=='vxrm'}
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if(vtype != null) {%>
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if(vtype != null) {%>
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uint${vstart.size}_t get_vstart(){return reg.vstart;}
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uint${vstart.size}_t get_vstart(){return reg.vstart;}
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void set_vstart(uint${vstart.size}_t val){reg.vstart = val;}
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void set_vstart(uint${vstart.size}_t val){reg.vstart = val;}
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uint${vl.size}_t get_vl(){return reg.vl;}
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uint${vl.size}_t get_vl(){return reg.vl;}
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uint${vtype.size}_t get_vtype(){return reg.vtype;}
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uint${vtype.size}_t get_vtype(){return reg.vtype;}
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uint${vxsat.size}_t get_vxsat(){return reg.vxsat;}
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void set_vxsat(uint${vxsat.size}_t val){reg.vxsat = val;}
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uint${vxrm.size}_t get_vxrm(){return reg.vxrm;}
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void set_vxrm(uint${vxrm.size}_t val){reg.vxrm = val;}
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<%} else { %>
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<%} else { %>
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uint32_t get_vstart(){return 0;}
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uint32_t get_vstart(){return 0;}
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void set_vstart(uint32_t val){}
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void set_vstart(uint32_t val){}
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uint32_t get_vl(){return 0;}
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uint32_t get_vl(){return 0;}
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uint32_t get_vtype(){return 0;}
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uint32_t get_vtype(){return 0;}
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uint32_t get_vxsat(){return 0;}
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void set_vxsat(uint32_t val){}
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uint32_t get_vxrm(){return 0;}
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void set_vxrm(uint32_t val){}
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<%}%>
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<%}%>
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};
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};
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@ -256,6 +256,10 @@ struct tgc5c: public arch_if {
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void set_vstart(uint32_t val){}
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void set_vstart(uint32_t val){}
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uint32_t get_vl(){return 0;}
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uint32_t get_vl(){return 0;}
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uint32_t get_vtype(){return 0;}
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uint32_t get_vtype(){return 0;}
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uint32_t get_vxsat(){return 0;}
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void set_vxsat(uint32_t val){}
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uint32_t get_vxrm(){return 0;}
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void set_vxrm(uint32_t val){}
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};
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};
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