adds new mnrs vp modeled after ehrenberg
This commit is contained in:
@ -5,124 +5,91 @@
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*/
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#include "tgc_vp/system.h"
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#include "minres/timer.h"
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#include "minres/uart.h"
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#include "scc/utilities.h"
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namespace tgc_vp {
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using namespace sc_core;
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using namespace vpvper::sifive;
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using namespace vpvper::minres;
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using namespace sysc::tgfs;
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system::system(sc_core::sc_module_name nm)
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: sc_core::sc_module(nm)
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, NAMED(router, platfrom_mmap.size() + 2, 2)
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{
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core_complex.ibus(router.target[0]);
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core_complex.dbus(router.target[1]);
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, NAMED(ahb_router, 3, 2)
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, NAMED(apbBridge, PipelinedMemoryBusToApbBridge_map.size(), 1){
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core_complex.ibus(ahb_router.target[0]);
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||||
core_complex.dbus(ahb_router.target[1]);
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||||
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ahb_router.initiator.at(0)(qspi.xip_sck);
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||||
ahb_router.set_target_range(0, 0xE0000000, 16_MB);
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ahb_router.initiator.at(1)(mem_ram.target);
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ahb_router.set_target_range(1, 0x80000000, 32_kB);
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||||
ahb_router.initiator.at(2)(apbBridge.target[0]);
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||||
ahb_router.set_target_range(2, 0xF0000000, 256_MB);
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size_t i = 0;
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for (const auto &e : platfrom_mmap) {
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router.initiator.at(i)(e.target);
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||||
router.set_target_range(i, e.start, e.size);
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||||
for (const auto &e : PipelinedMemoryBusToApbBridge_map) {
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||||
apbBridge.initiator.at(i)(e.target);
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||||
apbBridge.set_target_range(i, e.start, e.size);
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i++;
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}
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router.initiator.at(i)(mem_qspi.target);
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router.set_target_range(i, 0x20000000, 512_MB);
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router.initiator.at(++i)(mem_ram.target);
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||||
router.set_target_range(i, 0x80000000, 128_kB);
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uart1.clk_i(tlclk_s);
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qspi0.clk_i(tlclk_s);
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||||
qspi1.clk_i(tlclk_s);
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qspi2.clk_i(tlclk_s);
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pwm0.clk_i(tlclk_s);
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||||
pwm1.clk_i(tlclk_s);
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||||
pwm2.clk_i(tlclk_s);
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||||
gpio0.clk_i(tlclk_s);
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||||
plic.clk_i(tlclk_s);
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||||
aon.clk_i(tlclk_s);
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aon.lfclkc_o(lfclk_s);
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||||
prci.hfclk_o(tlclk_s); // clock driver
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clint.tlclk_i(tlclk_s);
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clint.lfclk_i(lfclk_s);
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core_complex.clk_i(tlclk_s);
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||||
mem_qspi.clk_i(tlclk_s);
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||||
mem_ram.clk_i(tlclk_s);
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gpio0.clk_i(clk_i);
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uart0.clk_i(clk_i);
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timer0.clk_i(clk_i);
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aclint.clk_i(clk_i);
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irq_ctrl.clk_i(clk_i);
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qspi.clk_i(clk_i);
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core_complex.clk_i(clk_i);
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//mem_ram.clk_i(clk_i);
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uart0.rst_i(rst_s);
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||||
uart1.rst_i(rst_s);
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||||
qspi0.rst_i(rst_s);
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||||
qspi1.rst_i(rst_s);
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||||
qspi2.rst_i(rst_s);
|
||||
pwm0.rst_i(rst_s);
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||||
pwm1.rst_i(rst_s);
|
||||
pwm2.rst_i(rst_s);
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||||
gpio0.rst_i(rst_s);
|
||||
plic.rst_i(rst_s);
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||||
aon.rst_o(rst_s);
|
||||
prci.rst_i(rst_s);
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||||
clint.rst_i(rst_s);
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||||
uart0.rst_i(rst_s);
|
||||
timer0.rst_i(rst_s);
|
||||
aclint.rst_i(rst_s);
|
||||
irq_ctrl.rst_i(rst_s);
|
||||
qspi.rst_i(rst_s);
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core_complex.rst_i(rst_s);
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||||
aon.erst_n_i(erst_n);
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aclint.mtime_int_o(mtime_int_s);
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||||
aclint.msip_int_o(msip_int_s);
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||||
irq_ctrl.irq_o(core_int_s);
|
||||
irq_ctrl.pending_irq_i(irq_int_s);
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||||
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||||
clint.mtime_int_o(mtime_int_s);
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||||
clint.msip_int_o(msie_int_s);
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||||
uart0.irq_o(irq_int_s[0]);
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||||
timer0.interrupt_o[0](irq_int_s[1]);
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||||
timer0.interrupt_o[1](irq_int_s[2]);
|
||||
qspi.irq_o(irq_int_s[3]);
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||||
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||||
plic.global_interrupts_i(global_int_s);
|
||||
plic.core_interrupt_o(core_int_s);
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||||
core_complex.sw_irq_i(msie_int_s);
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||||
core_complex.timer_irq_i(mtime_int_s);
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||||
core_complex.ext_irq_i(core_int_s);
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||||
core_complex.local_irq_i(local_int_s);
|
||||
core_complex.sw_irq_i(msip_int_s);
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pins_i(gpio0.pins_i);
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||||
gpio0.pins_i(pins_i);
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gpio0.pins_o(pins_o);
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||||
gpio0.oe_o(pins_oe_o);
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uart0.irq_o(global_int_s[3]);
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uart0.tx_o(uart0_tx_o);
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uart0.rx_i(uart0_rx_i);
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gpio0.iof0_i[5](qspi1.sck_o);
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||||
gpio0.iof0_i[3](qspi1.mosi_o);
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||||
qspi1.miso_i(gpio0.iof0_o[4]);
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||||
gpio0.iof0_i[2](qspi1.scs_o[0]);
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||||
gpio0.iof0_i[9](qspi1.scs_o[2]);
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||||
gpio0.iof0_i[10](qspi1.scs_o[3]);
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||||
timer0.clear_i(t0_clear_i);
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||||
timer0.tick_i(t0_tick_i);
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||||
qspi0.irq_o(global_int_s[5]);
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||||
qspi1.irq_o(global_int_s[6]);
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||||
qspi2.irq_o(global_int_s[7]);
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||||
qspi.ssclk_o(ssclk_o);
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||||
qspi.dq_o(dq_o);
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||||
qspi.dq_i(dq_i);
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qspi.oe_o(dq_oe_o);
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||||
gpio0.iof0_i[16](uart1.tx_o);
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uart1.rx_i(gpio0.iof0_o[17]);
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uart1.irq_o(global_int_s[4]);
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gpio0.iof1_i[0](pwm0.cmpgpio_o[0]);
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||||
gpio0.iof1_i[1](pwm0.cmpgpio_o[1]);
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||||
gpio0.iof1_i[2](pwm0.cmpgpio_o[2]);
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||||
gpio0.iof1_i[3](pwm0.cmpgpio_o[3]);
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||||
gpio0.iof1_i[10](pwm2.cmpgpio_o[0]);
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||||
gpio0.iof1_i[11](pwm2.cmpgpio_o[1]);
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||||
gpio0.iof1_i[12](pwm2.cmpgpio_o[2]);
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||||
gpio0.iof1_i[13](pwm2.cmpgpio_o[3]);
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||||
gpio0.iof1_i[19](pwm1.cmpgpio_o[0]);
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||||
gpio0.iof1_i[20](pwm1.cmpgpio_o[1]);
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||||
gpio0.iof1_i[21](pwm1.cmpgpio_o[2]);
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||||
gpio0.iof1_i[22](pwm1.cmpgpio_o[3]);
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pwm0.cmpip_o[0](global_int_s[40]);
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pwm0.cmpip_o[1](global_int_s[41]);
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||||
pwm0.cmpip_o[2](global_int_s[42]);
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||||
pwm0.cmpip_o[3](global_int_s[43]);
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pwm1.cmpip_o[0](global_int_s[44]);
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||||
pwm1.cmpip_o[1](global_int_s[45]);
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pwm1.cmpip_o[2](global_int_s[46]);
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||||
pwm1.cmpip_o[3](global_int_s[47]);
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pwm2.cmpip_o[0](global_int_s[48]);
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||||
pwm2.cmpip_o[1](global_int_s[49]);
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||||
pwm2.cmpip_o[2](global_int_s[50]);
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||||
pwm2.cmpip_o[3](global_int_s[51]);
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||||
SC_METHOD(gen_reset);
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sensitive << erst_n;
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}
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void system::gen_reset(){
|
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if(erst_n.read())
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rst_s = 0;
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else rst_s = 1;
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}
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} /* namespace sysc */
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