From bb4e2766d11fdfbf2908d99b3b11114fd37e93bc Mon Sep 17 00:00:00 2001 From: Eyck Jentzsch Date: Sat, 17 Aug 2024 13:33:14 +0200 Subject: [PATCH] applies clang-format --- gen_input/templates/llvm/CORENAME.cpp.gtl | 4 +- src/iss/arch/riscv_hart_m_p.h | 4 +- src/iss/arch/riscv_hart_msu_vp.h | 18 +- src/iss/arch/riscv_hart_mu_p.h | 22 +- src/iss/debugger/csr_names.cpp | 8196 ++++++++++----------- src/iss/debugger/riscv_target_adapter.h | 54 +- src/sysc/core_complex.cpp | 55 +- src/sysc/core_complex.h | 23 +- src/sysc/sc_core_adapter.h | 6 +- 9 files changed, 4185 insertions(+), 4197 deletions(-) diff --git a/gen_input/templates/llvm/CORENAME.cpp.gtl b/gen_input/templates/llvm/CORENAME.cpp.gtl index f362493..bcdf909 100644 --- a/gen_input/templates/llvm/CORENAME.cpp.gtl +++ b/gen_input/templates/llvm/CORENAME.cpp.gtl @@ -204,7 +204,7 @@ private: }; this->builder.CreateCall(this->mod->getFunction("print_disass"), args); } - this->gen_sync(iss::PRE_SYNC, instr_descr.size()); + this->gen_sync(iss::PRE_SYNC, instr_descr.size()); this->builder.CreateStore(this->builder.CreateLoad(this->get_typeptr(traits::NEXT_PC), get_reg_ptr(traits::NEXT_PC), true), get_reg_ptr(traits::PC), true); this->builder.CreateStore( @@ -381,4 +381,4 @@ volatile std::array dummy = { }; } } -// clang-format on \ No newline at end of file +// clang-format on diff --git a/src/iss/arch/riscv_hart_m_p.h b/src/iss/arch/riscv_hart_m_p.h index 8b27dec..70fd958 100644 --- a/src/iss/arch/riscv_hart_m_p.h +++ b/src/iss/arch/riscv_hart_m_p.h @@ -602,7 +602,7 @@ std::pair riscv_hart_m_p::load_file(std::str if(reader.get_machine() != EM_RISCV) throw std::runtime_error("wrong elf machine in file"); auto entry = reader.get_entry(); - for(const auto pseg : reader.segments) { + for(const auto& pseg : reader.segments) { const auto fsize = pseg->get_file_size(); // 0x42c/0x0 const auto seg_data = pseg->get_data(); const auto type = pseg->get_type(); @@ -689,7 +689,7 @@ iss::status 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const auto seg_data = pseg->get_data(); const auto type = pseg->get_type(); @@ -685,7 +685,7 @@ std::pair riscv_hart_mu_p::load_file(std::st CPPLOG(ERR) << "problem writing " << fsize << "bytes to 0x" << std::hex << pseg->get_physical_address(); } } - for(const auto sec : reader.sections) { + for(const auto& sec : reader.sections) { if(sec->get_name() == ".symtab") { if(SHT_SYMTAB == sec->get_type() || SHT_DYNSYM == sec->get_type()) { ELFIO::symbol_section_accessor symbols(reader, sec); @@ -877,8 +877,10 @@ iss::status riscv_hart_mu_p::read(const address_type type, c } return res; } catch(trap_access& ta) { - this->reg.trap_state = (1UL << 31) | ta.id; - fault_data = ta.addr; + if((access & access_type::DEBUG) == 0) { + this->reg.trap_state = (1UL << 31) | ta.id; + fault_data = ta.addr; + } return iss::Err; } } break; @@ -905,8 +907,10 @@ iss::status riscv_hart_mu_p::read(const address_type type, c } return iss::Ok; } catch(trap_access& ta) { - this->reg.trap_state = (1UL << 31) | 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4043 + "unknown", // 4044 + "unknown", // 4045 + "unknown", // 4046 + "unknown", // 4047 + "unknown", // 4048 + "unknown", // 4049 + "unknown", // 4050 + "unknown", // 4051 + "unknown", // 4052 + "unknown", // 4053 + "unknown", // 4054 + "unknown", // 4055 + "unknown", // 4056 + "unknown", // 4057 + "unknown", // 4058 + "unknown", // 4059 + "unknown", // 4060 + "unknown", // 4061 + "unknown", // 4062 + "unknown", // 4063 + "unknown", // 4064 + "unknown", // 4065 + "unknown", // 4066 + "unknown", // 4067 + "unknown", // 4068 + "unknown", // 4069 + "unknown", // 4070 + "unknown", // 4071 + "unknown", // 4072 + "unknown", // 4073 + "unknown", // 4074 + "unknown", // 4075 + "unknown", // 4076 + "unknown", // 4077 + "unknown", // 4078 + "unknown", // 4079 + "unknown", // 4080 + "unknown", // 4081 + "unknown", // 4082 + "unknown", // 4083 + "unknown", // 4084 + "unknown", // 4085 + "unknown", // 4086 + "unknown", // 4087 + "unknown", // 4088 + "unknown", // 4089 + "unknown", // 4090 + "unknown", // 4091 + "unknown", // 4092 + "unknown", // 4093 + "unknown", // 4094 + "unknown", // 4095 }; char const* const get_csr_name(unsigned i) { return csr_names[i]; } -} -} +} // namespace debugger +} // namespace iss diff --git a/src/iss/debugger/riscv_target_adapter.h b/src/iss/debugger/riscv_target_adapter.h index 83e9fcf..588c0c6 100644 --- a/src/iss/debugger/riscv_target_adapter.h +++ b/src/iss/debugger/riscv_target_adapter.h @@ -39,8 +39,6 @@ #include #include -#include -#include #include #ifndef FMT_HEADER_ONLY #define FMT_HEADER_ONLY @@ -109,7 +107,7 @@ public: status process_query(unsigned int& mask, const rp_thread_ref& arg, rp_thread_info& info) override; status thread_list_query(int first, const rp_thread_ref& arg, std::vector& result, size_t max_num, size_t& num, - bool& done) override; + bool& done) override; status current_thread_query(rp_thread_ref& thread) override; @@ -140,15 +138,11 @@ protected: rp_thread_ref thread_idx; }; -template -typename std::enable_if::FLEN!=0, unsigned>::type get_f0_offset() { +template typename std::enable_if::FLEN != 0, unsigned>::type get_f0_offset() { return iss::arch::traits::F0; } -template -typename std::enable_if::FLEN==0, unsigned>::type get_f0_offset() { - return 0; -} +template typename std::enable_if::FLEN == 0, unsigned>::type get_f0_offset() { return 0; } template status riscv_target_adapter::set_gen_thread(rp_thread_ref& thread) { thread_idx = thread; @@ -197,14 +191,14 @@ template status riscv_target_adapter::read_registers(std:: auto start_reg = arch::traits::X0; for(size_t i = 0; i < 33; ++i) { if(i < arch::traits::RFS || i == arch::traits::PC) { - auto reg_no = i<32? start_reg + i: arch::traits::PC; + auto reg_no = i < 32 ? start_reg + i : arch::traits::PC; unsigned offset = traits::reg_byte_offsets[reg_no]; - for(size_t j = 0; j < arch::traits::XLEN/8; ++j) { + for(size_t j = 0; j < arch::traits::XLEN / 8; ++j) { data.push_back(*(reg_base + offset + j)); avail.push_back(0xff); } } else { - for(size_t j = 0; j < arch::traits::XLEN/8; ++j) { + for(size_t j = 0; j < arch::traits::XLEN / 8; ++j) { data.push_back(0); avail.push_back(0); } @@ -229,15 +223,15 @@ template status riscv_target_adapter::write_registers(cons auto start_reg = arch::traits::X0; auto* reg_base = core->get_regs_base_ptr(); auto iter = data.data(); - auto iter_end = data.data()+data.size(); + auto iter_end = data.data() + data.size(); for(size_t i = 0; i < 33 && iter < iter_end; ++i) { auto reg_width = arch::traits::XLEN / 8; if(i < arch::traits::RFS) { auto offset = traits::reg_byte_offsets[start_reg + i]; - std::copy(iter, iter + reg_width, reg_base+offset); + std::copy(iter, iter + reg_width, reg_base + offset); } else if(i == 32) { auto offset = traits::reg_byte_offsets[arch::traits::PC]; - std::copy(iter, iter + reg_width, reg_base+offset); + std::copy(iter, iter + reg_width, reg_base + offset); } iter += reg_width; } @@ -246,7 +240,7 @@ template status riscv_target_adapter::write_registers(cons auto reg_width = arch::traits::FLEN / 8; for(size_t i = 0; i < 32 && iter < iter_end; ++i) { unsigned offset = traits::reg_byte_offsets[fstart_reg + i]; - std::copy(iter, iter + reg_width, reg_base+offset); + std::copy(iter, iter + reg_width, reg_base + offset); iter += reg_width; } } @@ -255,7 +249,7 @@ template status riscv_target_adapter::write_registers(cons template status riscv_target_adapter::read_single_register(unsigned int reg_no, std::vector& data, std::vector& avail) { - if(reg_no ::reg_bit_width(static_cast::reg_e>(reg_no))/8; auto* reg_base = core->get_regs_base_ptr(); @@ -349,7 +343,7 @@ template status riscv_target_adapter::add_break(break_type auto eaddr = map_addr({iss::access_type::FETCH, iss::address_type::PHYSICAL, 0, addr + length}); target_adapter_base::bp_lut.addEntry(++target_adapter_base::bp_count, saddr.val, eaddr.val - saddr.val); CPPLOG(TRACE) << "Adding breakpoint with handle " << target_adapter_base::bp_count << " for addr 0x" << std::hex << saddr.val - << std::dec; + << std::dec; CPPLOG(TRACE) << "Now having " << target_adapter_base::bp_lut.size() << " breakpoints"; return Ok; } @@ -379,7 +373,7 @@ template status riscv_target_adapter::remove_break(break_t template status riscv_target_adapter::resume_from_addr(bool step, int sig, uint64_t addr, rp_thread_ref thread, - std::function stop_callback) { + std::function stop_callback) { auto* reg_base = core->get_regs_base_ptr(); auto reg_width = arch::traits::reg_bit_widths[arch::traits::PC] / 8; auto offset = traits::reg_byte_offsets[arch::traits::PC]; @@ -398,17 +392,20 @@ template status riscv_target_adapter::target_xml_query(std oss << " \n"; oss << " \n"; auto reg_base_num = iss::arch::traits::X0; - for(auto i = 0U; i::RFS; ++i) { - oss << " ::reg_bit_widths[reg_base_num + i] << "\" type=\"int\" regnum=\"" << i << "\"/>\n"; + for(auto i = 0U; i < iss::arch::traits::RFS; ++i) { + oss << " ::reg_bit_widths[reg_base_num + i] + << "\" type=\"int\" regnum=\"" << i << "\"/>\n"; } - oss << " ::reg_bit_widths[iss::arch::traits::PC] << "\" type=\"code_ptr\" regnum=\"" << 32U << "\"/>\n"; + oss << " ::reg_bit_widths[iss::arch::traits::PC] + << "\" type=\"code_ptr\" regnum=\"" << 32U << "\"/>\n"; oss << " \n"; if(iss::arch::traits::FLEN > 0) { oss << " \n"; - auto reg_base_num = get_f0_offset(); - auto type = iss::arch::traits::FLEN==32?"ieee_single":"riscv_double"; - for(auto i = 0U; i<32; ++i) { - oss << " ::reg_bit_widths[reg_base_num + i] << "\" type=\""<\n"; + auto reg_base_num = get_f0_offset(); + auto type = iss::arch::traits::FLEN == 32 ? "ieee_single" : "riscv_double"; + for(auto i = 0U; i < 32; ++i) { + oss << " ::reg_bit_widths[reg_base_num + i] + << "\" type=\"" << type << "\" regnum=\"" << i + 33 << "\"/>\n"; } oss << " ::XLEN << "\" regnum=\"103\" type int/>\n"; oss << " ::XLEN << "\" regnum=\"101\" type int/>\n"; @@ -420,12 +417,13 @@ template status riscv_target_adapter::target_xml_query(std std::vector avail; data.resize(sizeof(typename traits::reg_t)); avail.resize(sizeof(typename traits::reg_t)); - for(auto i = 0U; i<4096; ++i) { + for(auto i = 0U; i < 4096; ++i) { typed_addr_t a(iss::access_type::DEBUG_READ, traits::CSR, i); std::fill(avail.begin(), avail.end(), 0xff); auto res = core->read(a, data.size(), data.data()); if(res == iss::Ok) { - oss << " ::XLEN << "\" type=\"int\" regnum=\"" << (i + csr_offset) << "\"/>\n"; + oss << " ::XLEN + << "\" type=\"int\" regnum=\"" << (i + csr_offset) << "\"/>\n"; } } oss << " \n"; diff --git a/src/sysc/core_complex.cpp b/src/sysc/core_complex.cpp index 7753ddf..274cd99 100644 --- a/src/sysc/core_complex.cpp +++ b/src/sysc/core_complex.cpp @@ -42,7 +42,6 @@ #include #endif #include "sc_core_adapter_if.h" -#include #include #include #include @@ -208,8 +207,7 @@ core_complex::core_complex(sc_module_name const& name) } #endif -template -void core_complex::init() { +template void core_complex::init() { trc = new core_trace(); ibus.register_invalidate_direct_mem_ptr([=](uint64_t start, uint64_t end) -> void { auto lut_entry = fetch_lut.getEntry(start); @@ -254,19 +252,16 @@ void core_complex::init() { #endif } -template -core_complex::~core_complex() { +template core_complex::~core_complex() { delete cpu; delete trc; for(auto* p : plugin_list) delete p; } -template -void core_complex::trace(sc_trace_file* trf) const {} +template void core_complex::trace(sc_trace_file* trf) const {} -template -void core_complex::before_end_of_elaboration() { +template void core_complex::before_end_of_elaboration() { SCCDEBUG(SCMOD) << "instantiating iss::arch::tgf with " << GET_PROP_VALUE(backend) << " backend"; // cpu = scc::make_unique(this); cpu = new core_wrapper(this); @@ -307,8 +302,7 @@ void core_complex::before_end_of_elaboration() { } } -template -void core_complex::start_of_simulation() { +template void core_complex::start_of_simulation() { // quantum_keeper.reset(); if(GET_PROP_VALUE(elf_file).size() > 0) { istringstream is(GET_PROP_VALUE(elf_file)); @@ -331,8 +325,7 @@ void core_complex::start_of_simulation() { } } -template -bool core_complex::disass_output(uint64_t pc, const std::string instr_str) { +template bool core_complex::disass_output(uint64_t pc, const std::string instr_str) { if(trc->m_db == nullptr) return false; if(trc->tr_handle.is_active()) @@ -346,8 +339,7 @@ bool core_complex::disass_output(uint64_t pc, const std::string instr_ return true; } -template -void core_complex::forward() { +template void core_complex::forward() { #ifndef CWR_SYSTEMC set_clock_period(clk_i.read()); #else @@ -356,30 +348,24 @@ void core_complex::forward() { #endif } -template -void core_complex::set_clock_period(sc_core::sc_time period) { +template void core_complex::set_clock_period(sc_core::sc_time period) { curr_clk = period; if(period == SC_ZERO_TIME) cpu->set_interrupt_execution(true); } -template -void core_complex::rst_cb() { +template void core_complex::rst_cb() { if(rst_i.read()) cpu->set_interrupt_execution(true); } -template -void core_complex::sw_irq_cb() { cpu->local_irq(3, sw_irq_i.read()); } +template void core_complex::sw_irq_cb() { cpu->local_irq(3, sw_irq_i.read()); } -template -void core_complex::timer_irq_cb() { cpu->local_irq(7, timer_irq_i.read()); } +template void core_complex::timer_irq_cb() { cpu->local_irq(7, timer_irq_i.read()); } -template -void core_complex::ext_irq_cb() { cpu->local_irq(11, ext_irq_i.read()); } +template void core_complex::ext_irq_cb() { cpu->local_irq(11, ext_irq_i.read()); } -template -void core_complex::local_irq_cb() { +template void core_complex::local_irq_cb() { for(auto i = 0U; i < local_irq_i.size(); ++i) { if(local_irq_i[i].event()) { cpu->local_irq(16 + i, local_irq_i[i].read()); @@ -387,8 +373,7 @@ void core_complex::local_irq_cb() { } } -template -void core_complex::run() { +template void core_complex::run() { wait(SC_ZERO_TIME); // separate from elaboration phase do { wait(SC_ZERO_TIME); @@ -406,8 +391,7 @@ void core_complex::run() { sc_stop(); } -template -bool core_complex::read_mem(uint64_t addr, unsigned length, uint8_t* const data, bool is_fetch) { +template bool core_complex::read_mem(uint64_t addr, unsigned length, uint8_t* const data, bool is_fetch) { auto& dmi_lut = is_fetch ? fetch_lut : read_lut; auto lut_entry = dmi_lut.getEntry(addr); if(lut_entry.get_granted_access() != tlm::tlm_dmi::DMI_ACCESS_NONE && addr + length <= lut_entry.get_end_address() + 1) { @@ -465,8 +449,7 @@ bool core_complex::read_mem(uint64_t addr, unsigned length, uint8_t* c } } -template -bool core_complex::write_mem(uint64_t addr, unsigned length, const uint8_t* const data) { +template bool core_complex::write_mem(uint64_t addr, unsigned length, const uint8_t* const data) { auto lut_entry = write_lut.getEntry(addr); if(lut_entry.get_granted_access() != tlm::tlm_dmi::DMI_ACCESS_NONE && addr + length <= lut_entry.get_end_address() + 1) { auto offset = addr - lut_entry.get_start_address(); @@ -514,8 +497,7 @@ bool core_complex::write_mem(uint64_t addr, unsigned length, const uin } } -template -bool core_complex::read_mem_dbg(uint64_t addr, unsigned length, uint8_t* const data) { +template bool core_complex::read_mem_dbg(uint64_t addr, unsigned length, uint8_t* const data) { tlm::tlm_generic_payload gp; gp.set_command(tlm::TLM_READ_COMMAND); gp.set_address(addr); @@ -525,8 +507,7 @@ bool core_complex::read_mem_dbg(uint64_t addr, unsigned length, uint8_ return dbus->transport_dbg(gp) == length; } -template -bool core_complex::write_mem_dbg(uint64_t addr, unsigned length, const uint8_t* const data) { +template bool core_complex::write_mem_dbg(uint64_t addr, unsigned length, const uint8_t* const data) { write_buf.resize(length); std::copy(data, data + length, write_buf.begin()); // need to copy as TLM does not guarantee data integrity tlm::tlm_generic_payload gp; diff --git a/src/sysc/core_complex.h b/src/sysc/core_complex.h index b44050f..f3c9d60 100644 --- a/src/sysc/core_complex.h +++ b/src/sysc/core_complex.h @@ -33,10 +33,10 @@ #ifndef _SYSC_CORE_COMPLEX_H_ #define _SYSC_CORE_COMPLEX_H_ +#include #include #include #include -#include #include #include #ifdef CWR_SYSTEMC @@ -71,28 +71,27 @@ struct core_complex_if { virtual ~core_complex_if() = default; - virtual bool read_mem(uint64_t addr, unsigned length, uint8_t* const data, bool is_fetch) =0; + virtual bool read_mem(uint64_t addr, unsigned length, uint8_t* const data, bool is_fetch) = 0; - virtual bool write_mem(uint64_t addr, unsigned length, const uint8_t* const data) =0; + virtual bool write_mem(uint64_t addr, unsigned length, const uint8_t* const data) = 0; - virtual bool read_mem_dbg(uint64_t addr, unsigned length, uint8_t* const data) =0; + virtual bool read_mem_dbg(uint64_t addr, unsigned length, uint8_t* const data) = 0; - virtual bool write_mem_dbg(uint64_t addr, unsigned length, const uint8_t* const data) =0; + virtual bool write_mem_dbg(uint64_t addr, unsigned length, const uint8_t* const data) = 0; - virtual bool disass_output(uint64_t pc, const std::string instr) =0; + virtual bool disass_output(uint64_t pc, const std::string instr) = 0; - virtual unsigned get_last_bus_cycles() =0; + virtual unsigned get_last_bus_cycles() = 0; //! Allow quantum keeper handling - virtual void sync(uint64_t) =0; + virtual void sync(uint64_t) = 0; virtual char const* hier_name() = 0; scc::sc_in_opt mtime_i{"mtime_i"}; }; -template -class core_complex : public sc_core::sc_module, public scc::traceable, public core_complex_if { +template class core_complex : public sc_core::sc_module, public scc::traceable, public core_complex_if { public: tlm::scc::initiator_mixin> ibus{"ibus"}; @@ -208,9 +207,7 @@ public: void set_clock_period(sc_core::sc_time period); - char const* hier_name() override { - return name(); - } + char const* hier_name() override { return name(); } protected: void before_end_of_elaboration() override; diff --git a/src/sysc/sc_core_adapter.h b/src/sysc/sc_core_adapter.h index f60cac4..3820980 100644 --- a/src/sysc/sc_core_adapter.h +++ b/src/sysc/sc_core_adapter.h @@ -55,8 +55,8 @@ public: s << "[p:" << lvl[this->reg.PRIV] << ";s:0x" << std::hex << std::setfill('0') << std::setw(sizeof(reg_t) * 2) << (reg_t)this->state.mstatus << std::dec << ";c:" << this->reg.icount + this->cycle_offset << "]"; SCCDEBUG(owner->hier_name()) << "disass: " - << "0x" << std::setw(16) << std::right << std::setfill('0') << std::hex << pc << "\t\t" << std::setw(40) - << std::setfill(' ') << std::left << instr << s.str(); + << "0x" << std::setw(16) << std::right << std::setfill('0') << std::hex << pc << "\t\t" + << std::setw(40) << std::setfill(' ') << std::left << instr << s.str(); } }; @@ -113,7 +113,7 @@ public: iss::status read_csr(unsigned addr, reg_t& val) override { if((addr == iss::arch::time || addr == iss::arch::timeh)) { - uint64_t time_val = owner->mtime_i.get_interface()? owner->mtime_i.read():0; + uint64_t time_val = owner->mtime_i.get_interface() ? owner->mtime_i.read() : 0; if(addr == iss::arch::time) { val = static_cast(time_val); } else if(addr == iss::arch::timeh) {